作者： 单位：中国电子信息产业发展院 出版：《世界电子元器件》2019年第05期 页数：2页  （PDF与DOC格式可能不同） PDF编号：PDFSDYQ2019050240 DOC编号：DOCSDYQ2019050249 下载格式：PDF + Word/doc 文字可复制、可编辑
《基于FPGA的宽带ADC采集系统的设计与实现》PDF+DOC2016年第04期 李赛辉,刘剑,蒋廼倜,李伟 《大尺寸光电二极管》PDF+DOC1996年第07期 顾聚兴 《野战型雷达接收机噪声系数测试仪》PDF+DOC1997年第04期 薛周成,祖士珍 《高性能低成本电子秤的参考设计》PDF+DOC2006年第05期 Colm Slattery,Mariah Nie 《基于CMOS图像传感器中DPGA的电容阵列优化研究》PDF+DOC2005年第02期 戴山小,姚素英,赵毅强,张为,李树荣,张生才,徐江涛 《非均匀噪声环境下宽带近场源定位的两种改进方法》PDF+DOC2004年第05期 张瑞娟,廖桂生 《极低频/超低频/甚低频宽带磁传感器技术研究》PDF+DOC2012年第03期 陶伟,张世田,刘新安,高俊 《基于结构优化的微型磁通门降噪技术研究》PDF+DOC2018年第04期 吕辉,杨慧慧 《主动声纳宽带噪声调频信号分析》PDF+DOC2012年第05期 郭瑞,蔡志明,姚直象 《产业信息》PDF+DOC2014年第03期

    • 高速多通道应用需要低噪声、可扩展且可进行精确通道间偏差调节的时钟解决方案，以实现最佳系统SNR、SFDR和ENOB。此参考设计使用一个主时钟器件和多个从时钟器件，支持高通道数JESD204B同步时钟。此设计可提供多通道JESD204B时钟，采用TI LMK04828时钟抖动清除器和带有集成式VCO的LMX2594宽带PLL，能够实现低于10ps的时钟间偏差。此设计经过TI

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