作者：徐珏亮,费霞 单位：天津市电子仪表信息研究所 出版：《数字技术与应用》2012年第11期 页数：2页  （PDF与DOC格式可能不同） PDF编号：PDFSZJT2012110930 DOC编号：DOCSZJT2012110939 下载格式：PDF + Word/doc 文字可复制、可编辑

    • 介绍了一种S波段低相噪捷变频频率综合器设计方法。由于采用DDS+PLL的方式使此频率综合器相噪优于-115dBc/Hz@1kHz，跳频时间小于5us。

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