作者：陈勇,姚新宇,潘玉林,唐小凤 单位：华北计算机系统工程研究所 出版：《》 页数：4页  （PDF与DOC格式可能不同） PDF编号：PDFDZJY2012010500 DOC编号：DOCDZJY2012010509 下载格式：PDF + Word/doc 文字可复制、可编辑

    • 在雷达实时仿真系统中，通过匹配滤波法，利用FPGA硬件实现了数字脉冲压缩功能模块。根据仿真系统通用性要求，定义了标准的模块接口界面；依据频域FFT法，设计了流水式并行结构，满足信号的实时输入输出与高速处理，并给出了共享FFT引擎结构，节省近一半资源。为了进一步减少理论误差，引入分段卷积思想，具体设计了重叠相加法电路。实验结果表明，多种方案完成了预期压缩功能，数据吞吐率达到每秒数十兆，处理时间仅约10μs。

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