作者： 单位：电子工业出版社;美国国际数据集团 出版：《今日电子》2013年第08期 页数：3页  （PDF与DOC格式可能不同） PDF编号：PDFDZJR2013080230 DOC编号：DOCDZJR2013080239 下载格式：PDF + Word/doc 文字可复制、可编辑

    • 无线基站射频卡低噪声计时芯片组8V19N4xx芯片组包括了JESD204B相兼容的灵活的射频锁相环(RF PLL)和时钟合成器，能满足2G、3G和4GLTE无线基础设施中高频率和低相位噪声的需求。通过采用IDT已被验证的FemtoClock NG技术，这种低相位噪声特性可使系统的模数和数模转换器(ADCs/DACs)实现高精度和低失真

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